怎么辦呢?我們將CPU到第一片顆粒之間的線長(zhǎng)延長(zhǎng)至2100mil,顆粒之間線長(zhǎng)延長(zhǎng)至700mil之后:
【錦囊五】PCB設(shè)計(jì)中關(guān)于反射的那些事兒
發(fā)布時(shí)間:2015-01-21 來源:陳德恒 一博科技 責(zé)任編輯:sherryyu
【導(dǎo)讀】繼續(xù)精心送上專家福利啦!前面小編為大家?guī)砹薖CB設(shè)計(jì)中反射疑云的相關(guān)知識(shí),這里小編將繼續(xù)為大家介紹PCB設(shè)計(jì)中關(guān)于反射的相關(guān)問題知識(shí)!這里主要帶來的是PCB設(shè)計(jì)中反射中深入反射的相關(guān)知識(shí)分析!
終于專家更新完了關(guān)于PCB設(shè)計(jì)中關(guān)于反射的相關(guān)知識(shí),謝謝大家能這么耐心的等待。
深入反射
問:窮人思維和富人思維有什么區(qū)別?
答:我拿到一2.4mm的20層板給它的28G信號(hào)通道做優(yōu)化,將信號(hào)安排在最后幾層,花了很久的時(shí)間在孔徑,pad,antipad,taper,孔距,地孔數(shù)量上做平衡,在最后為20mil長(zhǎng)的stub需不需要背鉆做整體評(píng)估時(shí),客戶拍拍我的肩膀說:“小陳吶,別那么麻煩了,用鐳射孔走第三層嘛,過孔短,stub也短”。
真實(shí)故事改編,逗大家一樂。
回顧上一期問題,平時(shí)大家想到減小反射的方法大多在匹配傳輸線阻抗,源端串阻,末端端接,進(jìn)一步的還有容性負(fù)載補(bǔ)償。
除了減小反射本身,是否還有別的方法呢?有,避開諧振點(diǎn)。
下面是一個(gè)簡(jiǎn)單的DDR3時(shí)鐘一驅(qū)四的拓?fù)?,時(shí)鐘頻率為500MHz:
CPU到第一片顆粒長(zhǎng)度為1500mil,顆粒與顆粒之間的長(zhǎng)度為500mil,這時(shí)接收顆粒的波形如下:
拓?fù)錄]有問題,末端也用匹配電阻上拉了,負(fù)載也并不多,為什么裕量那么???
回想一下前幾節(jié)說的,500HMz的時(shí)鐘信號(hào)頻域分量主要在500MHz,1.5GHz,這幾個(gè)頻率分量的四分之一波長(zhǎng)分別為3000mil,1000mil。而我們當(dāng)前拓?fù)渲袃蓛芍g1500mil,500mil的線長(zhǎng)很容易就湊成了四分之一波長(zhǎng),諧振最嚴(yán)重的長(zhǎng)度。
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怎么辦呢?我們將CPU到第一片顆粒之間的線長(zhǎng)延長(zhǎng)至2100mil,顆粒之間線長(zhǎng)延長(zhǎng)至700mil之后:
整體的裕量變大了,如果再稍微做一些容性負(fù)載補(bǔ)償:
裕量進(jìn)一步提升。實(shí)際操作時(shí)只需要在布局時(shí)稍微注意一下器件之間的距離,不需要增加成本,也不需要多余的繞線。
高速先生反射系列的文章到這里就結(jié)束了,最后總結(jié)一下:
●反射的本質(zhì)是波的反射,以及不同相位的波之間的疊加。
●反射影響的嚴(yán)重程度主要是以下兩點(diǎn):
1.阻抗不匹配程度,影響諧振幅值。阻抗越不匹配,諧振幅度越大。
2.阻抗不匹配長(zhǎng)度,影響諧振頻率,不匹配長(zhǎng)度越長(zhǎng),諧振頻率越低。
●需要根據(jù)實(shí)際情況分析反射的影響,對(duì)癥下藥。
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